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每期人數(shù)限3到5人。

上課時間和地點

上課地點：【上海】：同濟大學(滬西)/新城金郡商務樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學成教院【北京分部】：北京中山學院/福鑫大樓【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路）【成都分部】：領館區(qū)1號（中和大道）【沈陽分部】：沈陽理工大學/六宅臻品【鄭州分部】：鄭州大學/錦華大廈【石家莊分部】：河北科技大學/瑞景大廈【廣州分部】：廣糧大廈【西安分部】：協(xié)同大廈
最近開課時間(周末班/連續(xù)班/晚班）：2020年3月16日

實驗設備

　    ☆資深工程師授課

        ☆注重質(zhì)量 ☆邊講邊練
        ☆合格學員免費推薦工作
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質(zhì)量保障

        1、培訓過程中，如有部分內(nèi)容理解不透或消化不好，可免費在以后培訓班中重聽；
        2、培訓結(jié)束后,授課老師留給學員聯(lián)系方式,保障培訓效果,免費提供課后技術(shù)支持。
        3、培訓合格學員可享受免費推薦就業(yè)機會。

課程大綱

基于QuartusII的FPGA/CPLD數(shù)字系統(tǒng)設計與應用培訓
? 基于QuartusII的FPGA/CPLD數(shù)字系統(tǒng)設計與應用培訓
課程大綱：
1、FPGA/CPLD簡介
2、Quartus?Ⅱ開發(fā)指南
3、硬件描述語言Verilog?HDL設計基礎
4、門電路設計范例
5、組合邏輯電路設計范例
6、時序邏輯電路設計范例
7、數(shù)字系統(tǒng)設計范例
8、可參數(shù)化宏模塊及IP核的使用
9、SOPC綜合實踐
10、基于FPGA的信號捕獲實現(xiàn)
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